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VLion

VLion(FPGA原型验证平台)基于交换架构的超大规模多FPGA芯片原型验证系统VLion,创新性的将高速交换架构应用于FPGA原型验证硬件平台,搭载具有自主知识产权的云原生全流程软件,配备丰富的外设接口资源池,轻松实现FPGA原型验证上云。
产品支持SoC/ASIC各类芯片原型验证的自动综合、自动划分映射、自动优化和深度调试,大大提升芯片开发团队的验证效率,为系统验证和软件开发提供大容量、高性能、可调试的新一代智能FPGA原型验证平台。

产品功能
  • 支持SoC/ASIC各类芯片原型验证自动综合和资源预估
  • 多FPGA验证时对用户设计自动划分映射
  • 用户设计时钟域智能分析
  • 仿真性能自动优化
  • 仿真主频预估
  • 海量信号深度调试
  • 基于Web的前端波形展示
产品优势
  • 智能化项目分割和IO复用,自动实现大规模芯片项目的多FPGA多模式互连

  • 提供了高逻辑密度和I/O数量,搭配业界标准的FMC连接器以及专用高速串行连接器,实现丰富的物理接口子板和PHY子板支持

  • FPGA仿真资源及外设资源虚拟化,实现原型验证上云,私有云+公有云混合云,可靠、安全,高效管理资源

  • 支持多种深度调测手段和RTL级调试能力,配合在线图形调试,帮助调试和定位问题

  • 支持多种标准的波形和数据格式,与第三方工具灵活集成

  • 一键实现ASIC设计到FPGA原型的全流程,缩短从设计验证到软件开发的迭代周期

用户痛点
  • 对FPGA原型验证平台的访问不应受到地域限制,实现远程访问和远程管理的功能。地域限制的访问权限对现代SoC设计团队(尤其是软件开发团队)来说是一个重大障碍,因为它们通常是全球分布的。

  • 编译和构建环境必须包含重要的特性,包括:自动划分设计和用户参与指导划分的能力;划分后端口IP自动插入;时钟域自动分析;划分后设计自动映射FPGA;允许用户修改设计和ECO的快速流程周转。

  • 性能——针对用户大规模设计,进行多FPGA的原型验证时,受到FPGA之间通信瓶颈影响,导致系统仿真速率只有5MHz左右,远远低于单FPGA方正性能。

  • 高速接口和附加组件(如PCIe、USB、10GE、ARM调试器和DDR内存)对于构建完整的开发平台非常重要。CAPI和AXI总线协议等事务级接口的支持极大地扩展了系统的实用性。

  • 扩展系统的能力也是一个重要的考虑因素。这包括增加门容量和内存,以及处理器和通信接口,以增加系统功能。 跨多个FPGA的海量信号深度调试和跟踪功能。

  • 支持混合级别的原型。通常在开发过程中,RTL中并不是所有的块都可用。一个完整的原型系统应该支持运行在主机上的行为块与映射到FPGA的RTL块进行接口和通信。

VLion(FPGA原型验证平台)白皮书
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