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VHawk
HDL代码缺陷检查管理平台
VHawk是一款针对Verilog-HDL与VHDL语言的代码缺陷检查管理平台。采用国内先进的HDL代码静态分析技术，VHawk提供 HDL代码编码风格、可综合性、可重用性、时钟复位以及状态机等潜在设计缺陷自动化检测、缺陷跟踪及管理一站式解决方案。VHawk支持Do254、GJB、GB、Xilinx、Altera等主流HDL编码规则集，能有效提高ASIC及FPGA的HDL编码质量，便于RTL签核，减少昂贵的重新设计与迭代所产生的经济代价和时间成本。
展开VHAWK支持DO254、ALTERA、RMM、XILINX等主流编码规则的静态检查，支持创建和配置新的检查规则集。
示例效果提供基于通用模板的检查结果报告意见导出，提供定制化模板支持。
示例效果VHAWK提供针对VERILOG-HDL/VHDL的代码静态检查功能。采用了基于编码规则的HDL代码静态分析技术，能够自动检查并发现HDL代码中的缺陷代码。
示例效果VHAWK提供违规代码的定位跳转功能，在代码编辑界面高亮提示违规代码指导用户修复缺陷代码。
示例效果VHAWK支持DO254、ALTERA、RMM、XILINX等主流编码规则的静态检查，支持创建和配置新的检查规则集。
提供基于通用模板的检查结果报告意见导出，提供定制化模板支持。
VHAWK提供针对VERILOG-HDL/VHDL的代码静态检查功能。采用了基于编码规则的HDL代码静态分析技术，能够自动检查并发现HDL代码中的缺陷代码。
VHAWK提供违规代码的定位跳转功能，在代码编辑界面高亮提示违规代码指导用户修复缺陷代码。
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